<div dir="ltr"><br><br><div class="gmail_quote">On Thu, Oct 16, 2008 at 9:49 AM, ron minnich <span dir="ltr"><<a href="mailto:rminnich@gmail.com">rminnich@gmail.com</a>></span> wrote:<br><blockquote class="gmail_quote" style="border-left: 1px solid rgb(204, 204, 204); margin: 0pt 0pt 0pt 0.8ex; padding-left: 1ex;">
<div><div></div><div class="Wj3C7c">On Thu, Oct 16, 2008 at 8:48 AM, Myles Watson <<a href="mailto:mylesgw@gmail.com">mylesgw@gmail.com</a>> wrote:<br>
>> >> > Check PCI: 1022:2067<br>
>> >> > found<br>
>> >> > 0xb102: return 0x120<br>
>><br>
>> the wrong # here?<br>
><br>
> Yes.  It should be device # 4 as far as I can tell.  In the debugger when I<br>
> do a config read to bus 1 dev 4 function 0 I get the right data back.  When<br>
> I do a read to bus 1 dev 2 function 0 I get an error that no device<br>
> responded.<br>
><br>
> Like I said, I don't know why the reads succeed.<br>
><br>
<br>
</div></div>so you need some debug prints in the PCIBIOS support code.<br>
<font color="#888888"></font></blockquote><div><br>Check PCI: 1022:2067<br>PCI: 01:04.0 found<br>bus->secondary = 0x1 dev->path.pci.devfn = 0x20<br>0xb102: return 0x120 <br></div></div><br>Now I'm confused.  I guess 0x120 was correct (the slot is the upper 5 bits of the byte), so I'm still looking.  Now it makes sense why the reads succeed, but the config write failure is puzzling.  It's trying to write 0xffffffff to the BAR, but that changes the memory map, so after that write there's garbage everywhere.  I still haven't found the config register that gets changed, but it's not in the VGA card's space.<br>
<br>Thanks,<br>Myles<br></div>